电子书籍科技半导体IC集成电路制造流程.docx
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电子书籍科技半导体IC集成电路制造流程
[电子书籍][科技]半导体IC集成电路制造流程
半导体IC集成电路制造流程
IC
半导体器件制造过程可概分为(WaferFabrication;简称WaferFab)
WaferProbe)(Packaging)(InitialTestandFinalTest)等几个步
骤。
一般称晶圆制造制程与晶圆针测制程为前道(FrontEnd)制程,而封装、测
晶圆制造制程之主要工作为在硅晶圆上制作电路与电子组件(如晶体管、电容
体、逻辑
闸等),为上述各制程中所需技术最复杂且资金投入最多的过程,以微处理器
(Microprocessor)为例,其所需处理步骤可达数百道,而其所需加工机台先进且昂贵,动
辄数千万一台,其所需制造环境为一温度、湿度与含尘量(Particle)均需控
制的无尘室(Clean-Room),虽然详细的处理程序是随着产品种类与所使用的技术有关;不过其基本处
理步骤通常是晶圆先经过适当的清洗(Cleaning)之后,接着进行氧化(Oxidation)及沉积,最后进行微影、蚀刻及离子注入等反复步骤,以完成晶圆上电路的加工与制作。
经过WaferFab制程之后,晶圆上即形成一格一格的小格,我们称之为晶方或
是晶粒
(Die),在一般情形下,同一片晶圆上皆制作相同的芯片,但是也有可能在同一片晶圆上制
作不同规格的产品(MP);这些晶圆必须通过芯片允收测试,晶粒将会一一经过针测
(Probe)仪器以测试其电气特性,而不合格的的晶粒将会被标上记号(InkDot,墨水打点),此程序即称之为晶圆针测制程(WaferProbe)。
然后晶圆将依晶粒为单位分割成一粒粒独立
的晶粒,接着晶粒将依其电气特性分类(Sort)并分入不同的仓(DieBank),而不合格的晶粒将于下一个制程中丢弃。
IC
IC封装制程(Packaging)则是利用塑料或陶瓷包装晶粒与配线以成集成电路(IntegratedCircuit;简称IC),此制程的目的是为了制造出所生产的电路的保护层,避免电路受到机械1/16
性刮伤或是高温破坏。
最后整个集成电路的周围会向外拉出脚架(Pin),称之为打线,作为半导体IC集成电路制造流程
与外界电路板连接之用。
半导体制造最后一个制程为测试,测试制程可分成初步测试(IT)与最终测试
(FT),其主要目的除了为保证顾客所要的货无缺点外,也将依规格划分IC的等
级。
在初步测试阶段,包装后的晶粒将会被置于各种环境下测试其电气特性,例如消耗功率、速度、电压容忍
度...等等。
测试后的IC将会将会依其电气特性划分等级而置入不同的Bin中(此过程称之为BinSplits),最后因应顾客之需求规格,于相对应的Bin中取出部份IC做特殊的测试及烧机(Burn-In),此即为最终测试。
最终测试的成品
将被贴上规格卷标(Brand)并加以包装而后交与顾客。
未通过的测试的产品将被降级(Downgrading)或丢弃。
硅晶柱的长成,首先需要将纯度相当高的硅矿放入熔炉中,并加入预先设定好的金属物
质,使产生出来的硅晶柱拥有要求的电性特质,接着需要将所有物质融化后再长成单晶的硅
晶柱,以下将对所有晶柱生长制程做介绍。
MeltDown
此过程是将置放于石英坩锅内的块状复晶硅加热制高于摄氏1420度的融化温度之上,此阶段中最重要的参数为坩锅的位置与热量的供应,若使用较大的功率来融化复晶硅,石英
坩锅的寿命会降低,反之功率太低则融化的过程费时太久,影响整体的产能。
NeckGrowth
当硅融浆的温度稳定之后,将<1.0.0>方向的晶种渐渐注入液中,接着将晶种往上拉升,
并使直径缩小到一定(约6mm,维持此直径并拉长10-20cm,以消除晶种内的排差(dislocation),此种零排差(dislocation-free)的控制主要为将排差局限在颈部的成长。
CrownGrowth
长完颈部后,慢慢地降低拉速与温度,使颈部的直径逐渐增加到所需的大小。
BodyGrowth
利用拉速与温度变化的调整来迟维持固定的晶棒直径,所以坩锅必须不断的上升来维持
固定的液面高度,于是由坩锅传到晶棒及液面的辐射热会逐渐增加,此辐射热源将致使固业
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半导体IC集成电路制造流程界面的温度梯度逐渐变小,所以在晶棒成长阶段的拉速必须逐渐地降低,以避免晶棒扭曲的
现象产生。
TailGrowth当晶体成长到固定(需要)的长度后,晶棒的直径必须逐渐地缩小,直到与液面分开,
此乃避免因热应力造成排差与滑移面现象。
硅晶柱生长后,整个晶圆的制作才到了一半,接下必须将晶柱做裁切与检测,裁切掉头
尾的晶棒将会进行外径研磨、切片等一连串的处理,最后才能成为一片片价值非凡的晶圆,
以下将对晶柱的后处理制程做介绍。
Slicing长久以来经援切片都是采用内径锯,其锯片是一环状薄叶片,内径边缘镶有钻石颗粒,
晶棒在切片前预先黏贴一石墨板,不仅有利于切片的夹持,更可以避免在最后切断阶段时锯
片离开晶棒所造的破裂。
切片晶圆的厚度、弓形度(boW及挠屈度(warp)等特性为制程管制要点影响晶圆质量的因素除了切割机台本身的稳定度与设计外,锯片的张力状况及
钻石锐利
度的保持都有很大的影响。
EdgePolishing
刚切好的晶圆,其边缘垂直于切割平面为锐利的直角,由于硅单晶硬脆的材料特性,此
角极易崩裂,不但影响晶圆强度,更为制程中污染微粒的来源,且在后续的半导体制成中,
未经处理的晶圆边缘也为影响光组与磊晶层之厚度,固须以计算机数值化机台自动修整切片
晶圆的边缘形状与外径尺寸。
Lapping
研磨的目的在于除去切割或轮磨所造成的锯痕或表面破坏层,同时使晶圆表面达到可进
行抛光处理的平坦度。
Etching
晶圆经前述加工制程后,表面因加工应力而形成一层损伤层(damagedlayer),在抛光
之前必须以化学蚀刻的方式予以去除,蚀刻液可分为酸性与碱性两种。
Gettering
利用喷砂法将晶圆上的瑕疵与缺陷感到下半层,以利往后的IC制程。
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半导体IC集成电路制造流程
Polishing
晶圆的抛光,依制程可区分为边缘抛光与表面抛光两种
EdgePolishing
边缘抛光的主要目的在于降低微粒(particle)附着于晶圆的可能性,并使晶圆具备较
佳的机械强度,但需要的设备昂贵且技术层面较高,除非各户要求,否则不进行本制程。
SurfacePolishing表面抛光是晶圆加工处理的最后一道步骤,移除晶圆表面厚度约10-20微米,其目的在改善前述制程中遗留下的微缺陷,并取得局部平坦度的极佳化,以满足IC制程的要求。
基本上本制程为化学-机械的反应机制,由研磨剂中的NaOH,KOH,NH4OH腐蚀晶圆的最表层,由机械摩擦作用提供腐蚀的动力来源。
基本晶圆制造步骤通常是晶圆先经过适当的清洗(Cleaning)之后,送到热炉管(Furnace)内,在含氧的环境中,以加热氧化(Oxidation)的方式在晶圆的表面形成一层厚约数百个的
二氧化硅(SiO2)层,紧接着厚约1000A到2000A的氮化硅(Si3N4)层将以化学气相沉积(ChemicalVaporDeposition;CVP的方式沉积(Deposition)在刚刚长成的二氧化硅上,然
后整个晶圆将进行微影(Lithography)的制程,先在晶圆上上一层光阻
(Photoresist),再将光罩上的图案移转到光阻上面。
接着利用蚀刻(Etching)技术,将部份未被光阻保护的氮化
硅层加以除去,留下的就是所需要的线路图部份。
接着以磷为离子源(Ion
Source),对整片晶圆进行磷原子的植入(IonImplantation),然后再把光阻剂去除(PhotoresistScrip)。
制程进行至此,我们已将构成集成电路所需的晶体管及部份的字符线(WordLines),依光罩所提供的设计图案,依次的在晶圆上建立完成,接着进行金属化制程(Metallization),制作金属导线,以便将各个晶体管与组件加以连接,而在每一道步骤加工完后都必须进行一些电性、
或是物理特性量测,以检验加工结果是否在规格内(Inspectionand
Measurement);如此重复步骤制作第一层、第二层.••的电路部份,以在硅晶圆上制造晶体管等其他电子组件;最
后所加工完成的产品会被送到电性测试区作电性量测。
根据上述制程之需要,FAB厂内通常可分为四大区:
1
本区的作用在于利用照相显微缩小的技术,定义出每一层次所需要的电路图,因为采用
感光剂易曝光,得在黄色灯光照明区域内工作,所以叫做「黄光区」。
微影成像(雕像术;lithography)
4/16
决定组件式样(pattern)尺寸(dimension)以及电路接线(routing)半导体IC
集成电路制造流程
在黄光室内完成,对温.湿度维持恒定的要求较其它制程高
一个现代的集成电路(IC)含有百万个以上的独立组件,而其尺寸通常在数微米,在此
种尺寸上,并无一合适的机械加工机器可以使用,取而代之的是微电子中使用紫外光的图案
转换(Patterning),这个过程是使用光学的图案以及光感应膜来将图案转上基板,此种过程
称为光刻微影(photolithography),此一过程的示意图说明于下图
M
M(B)
1■II
(c)(n)
光刻微影技主要在光感应薄膜,称之为光阻,而光阻必须符合以下五点要求:
1.光阻与基板面黏着必须良好。
2.在整个基板上,光阻厚度必须均匀。
3.在各个基板上,光阻厚度必须是可预知的。
4.光阻必须是感光的,所以才能做图案转换。
5.光阻必须不受基板蚀刻溶液的侵蚀。
在光刻微影过程,首先为光阻涂布,先将适量光阻滴上基板中心,而基板是置
于光阻涂
布机的真空吸盘上,转盘以每分钟数千转之转速,旋转30-60秒,使光阻均
匀涂布在基板上,转速与旋转时间,依所需光阻厚度而定
曝照于紫外光中,会使得光阻的溶解率改变。
紫外光通过光罩照射于光阻上,而在光照
及阴影处产生相对应的图形,而受光照射的地方,光阻的溶解率产生变化,称之为光化学反
应,而阴影处的率没有变化,这整个过称之为曝光(exposure)。
在曝光之后,利用显影剂来清洗基板,将光阻高溶解率部份去除,这个步骤,称之为显影
(Development),而光阻去
除的部份依不同型态的光阻而有不同,去除部份可以是被光照射部份或是阴影部份,如果曝
光增加光阻的溶解率,则此类光阻为正光阻,如果曝光降低光阻的溶解率,则称此类光阻为
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半导体IC集成电路制造流程负光阻。
在显影后,以蚀刻液来蚀刻含在有图案(pattern)光阻的基板蚀刻液去除未受光阻保护的基板部份,而受光阻保护部份,则未受蚀刻。
最后,光阻被去除,而基板上则保有被
制的图案。
1.上光阻
2.软烤(预烤):
90~100度C~30min<~~使光阻挥发变硬一点o3•曝光显像
4.硬烤:
200度C~30min<~~把剩下的挥发气体完全挥发使其更抗腐蚀,但不可烤太久因为最
后要把光阻去掉。
1.光阻(photoresist)
2.光罩(mask)
3.对准机(maskaligner)
4.曝光光源(exposuresource)
5.显像溶液(developesolution)
6.烤箱(heatingoven)
光阻:
1.正光阻:
曝光区域去除2.负光阻:
曝光区域留下
1.可见光4000~7000埃
2.紫外线<4000埃(深紫外线0.25um最多到0.18um,找不到合适的光阻及散热问题,但解析很好,可整片曝光。
3.X光~10埃(可整片曝光)
4.电子束视电子能量而定(速度慢(直接写入))波粒双重性质量愈大波愈小解析度和入波长有关电子9.1*10的负27kg就会有波的性质
1.直接接触式(contact):
分辨率高.光罩寿命短
2.微间距式(proximity):
分辨率低.光罩寿命长(20~50um)3.投射式
(projection):
分辨率高.镜片组复杂,步进式曝光.速度慢NA:
Numerical
Aperture(NA:
nsina)
DOF:
DepthofFocus景深(NA愈大,W分辨率愈小)分辨率W=0.6入/NA,
聚焦深度DOF=+-入/2(NA)2次方角度愈大,聚焦深度愈窄,聚焦深度愈深愈好
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半导体IC集成电路制造流程1.矩阵物质(MatrixMaterial;Resin):
决定光阻之机械特性即,光阻抵抗蚀刻的能力由此物质决定
2.感光物质:
决定对光的灵敏度是否成像
3.溶剂:
使光阻保持液态具挥发性
1.精确重现图样2.抗腐蚀性良好
3.光学特性:
包括分辨率光敏度及折射率
4.制程安全相关特性
1.较佳的黏着特性
2.曝光时间短生产快
3.较不受显像液之稀释程度及环境温度影响4.价格较便宜
2
蚀刻制程是将电路布局移转到芯片上之关键步骤,包括蚀刻及蚀刻后清洗两部份,本所
现阶段以多层导线所需之蚀刻及清洗技术为重点。
蚀刻技术开发已完成符合
0.15微米世代
制程规格之0.2微米接触窗蚀刻技术以及符合0.18微米世代制程规格(线宽/间距=0.22微米
/0.23微米)之铝导线蚀刻技术;同时完成光阻硬化技术,可提高光阻抗蚀刻
性10%~20%;
目前之技术重点在于双嵌入结构蚀刻技术及低介电常数材料蚀刻技术,以搭配铜导线制程达
成低电阻、低电容之目标。
蚀刻后清洗技术开发已建立基本之氧化层及金属层蚀刻后清洗能
力,目前之技术重点在双嵌入结构蚀刻后清洗技术,铜导线兼容之光阻去除技术、低介电常
数材料兼容之光阻去除技术、铜污染去除技术等。
经过黄光定义出我们所需要的电路图,把不要的部份去除掉,此去除的步骤就称之为蚀
刻,因为它好像雕刻,一刀一刀的削去不必要的木屑,完成作品,期间又利用酸液来腐蚀的,
所以叫做「蚀刻区」。
湿式蚀刻:
酸碱溶液(化学方式)选择性高等向蚀刻1.Through-put高
2.设备价格低
3.溶液更新频率<=>成本
4.溶液本身的污染
优点
1.(through-put)高
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半导体IC集成电路制造流程
2.设备价格低
3.溶液更新频率<->成本
4.溶液本身的污染
干式蚀刻:
电浆蚀刻(PlasmaEtching),活性离子蚀刻(RIE)(物理方式)选择性低非等向蚀刻撞击损伤(damages),负面影响:
晶格排列因撞击而偏移
撞击->能量传递->活化能降低->反应加速
1.选择性(Selectivity)
3.蚀刻速率(EtchingRate)
2.等向性(Isotropy)
4.芯片损伤(Damags)
3
本区的制造过程都在高温中进行,又称为「高温区」,利用高温给予物质能量而产生运动,因为本区的机台大都为一根根的炉管,所以也有人称为「炉管区」,每一根炉管都有不
同的作用。
影响热氧化速率的因素:
1.反应气体成分
2.温度
3.晶向
4.芯片搀杂浓度
SiO2良好的绝缘特性导至硅半导体及MOS吉构能够盛行的主要原因.第一个做出的是Ge半导体Ge(锗)无良好的氧化物所以分展硅o化合物半导体GaASInp常用在光电因会发光,n和p的浓度提高空乏区宽度变窄,因为技术愈来愈小由0.35到0.07要空乏区不碰到才行,
所以要提高浓度o
TEM穿透式电子显微镜
SEM扫瞄式电子显微镜
:
(Thermaloxidation)
1.干氧:
O2+si一>sio2
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2.湿氧:
H20+Si一>sio2+2H2
CVDSio2>WetSio2>DRYSio2
CVDSio2 CVDSio2: 今属间介电层 WetSio2: 场氧化层 DrySio2: 闸极氧化层 热氧化层<==>CVD氧化层高温900度低温700~800以下结构致密HF去吃很慢结构松散HF去吃很快高绝缘强度低绝缘强度 4 薄膜技术旨在开发应用于0.18微米以下,ULSI制程所需之成膜沉积技术,涵盖金属导线技术、介电层技术以及平坦化技术等三项子技术。 以金属导线技术而言,以铜导线沉积技 术研发为主,依据半导体制程发展趋势将开发高电浆密度物理性金属沉积技术、电化学沉积 技术以及化学气相沉积技术。 以介电层技术而言,主要分为先进介电值沉积技术及低介电常 数薄膜成膜技术,先进介电质沉积技术为开发高密度电浆化学气相沉积,介电质抗反射层氟 掺杂玻璃蚀刻阻挡层等应用于0.18微米之介电层沉积技术;而低介电常数膜主要应用于高 速组件传递延迟、功率消耗及干扰,本计划将针对此新材料之成膜应用加以研究。 平坦化技 术主要开发化学机械研磨相关技术,针对金属及介电质进行研磨及研磨后清洁技术之研发, 并针对研磨终点检测技术平坦化模拟、研磨后腐蚀及氧化之防治进行研究。 本区机器操作时,机器中都需要抽成真空,所以又称之为真空区,真空区的机器多用来 作沉积暨离子注入,也就是在Wafer上覆盖一层薄薄的薄膜,所以称之为「薄膜区」。 在真 空区中有一站称为晶圆允收区,可接受芯片的测试,针对我们所制造的芯片,其过程是否有 缺陷,电性的流通上是否有问题,由工程师根据其经验与电子学上知识做一全程的检测, 由某一电性量测值的变异判断某一道相关制程是否发生任何异常。 此检测不同于测试区 (WaferProbe)的检测,前者是细部的电子特性测试与物理特性测试,后者 所做的测试是针对产品的电性功能作检测。 晶圆针测(ChipProbing;CP之目的在于针对芯片作电性功能上的测试 (Test),使IC在进入封装前先行过滤出电性功能不良的芯片,以避免对不良品增加制造成本。 9/16 半导体制程中,针测制程只要换上不同的测试配件,便可与测试制程共享相同的测试半导体IC集成电路制造流程 机台(Tester)。 所以一般测试厂为提高测试机台的使用率,除了提供最终测试的服务亦接受 芯片测试的订单。 以下将此针测制程作一描述 上图为晶圆针测之流程图,其流程包括下面几道作业: ISorting 晶圆针测的主要目的是测试晶圆中每一颗晶粒的电气特性,线路的连接,检 查其是否为不良品,若为不良品,则点上一点红墨水,作为识别之用。 除此之外,另一个目的是测试 产品的良率,依良率的咼低来判断晶圆制造的过程是否有误。 良品率咼时表示晶圆制造过程 一切正常,若良品率过低,表示在晶圆制造的过程中,有某些步骤出现问题,必须尽快通知 工程师检查。 2LaserRepairing 雷射修补的目的是修补那些尚可被修复的不良品(有设计备份电路在其中者),提高产品的良品率。 当晶圆针测完成后,拥有备份电路的产品会与其在晶圆针测时所产生的测试 结果数据一同送往雷射修补机中,这些数据报括不良品的位置,线路的配置等。 雷射修补机 的控制计算机可依这些数据,尝试将晶圆中的不良品修复。 3Baking 加温烘烤是针测流程中的最后一项作业,加温烘烤的目的有二: (一)将点在晶粒上的红墨水烤干。 (二)清理晶圆表面。 经过加温烘烤的产品,只要有需求便可以出货。 随着IC产品需求量的日益提升,推动了电子封装产业的蓬勃发展。 而电子制造技术的 不断发展演进,在IC芯片「轻、薄、短、小、高功能」的要求下,亦使得封装技术不断推陈出新,以符合电子产品之需要并进而充分发挥其功能。 封装之目的主要有下列四种: (1)电力传送 (2)讯号输送(3)热的去除(4)电路保护所有电子产品皆以「电」为能源,然而电力之传送必须经过线路之连接方可达 成,IC封装即可达到此一功能。 而线路连接之后,各电子组件间的讯号传递自然可经由这些电路加10/16 以输送。 电子封装的另一功能则是藉由封装材料之导热功能将电子于线路间传递产生之热量半导体IC集成电路制造流程 去除,以避免IC芯片因过热而毁损。 最后,IC封装除对易碎的芯片提供了足够的机械强度 及适当的保护,亦避免了精细的集成电路受到污染的可能性。 IC封装除能提供 上述之主要功能之外,额外亦使IC产品具有优雅美观的外表并为使用者提供了安全的使用及简便的操作 环境。 IC封装依使用材料可分为ceramic及plastic两种,而目前商业应用上则以塑料封装为主。 以塑料封装中打线接合为例,其步骤依序为(diesaw)、(die mount/diebond)、(wirebond)、(mold)、/形(trim/form)、 mark)、 (plating)及(inspection)等。 以下依序对封装制程之各个步骤做一说明: DieSaw 芯片切割之目的为将前制程加工完成之晶圆上一颗颗之晶粒(die)切割分离。 欲进行芯片切割,首先必须进行晶圆黏片,而后再送至芯片切割机上进行切割。 切割完后之晶粒井 然有序排列于胶带上,而框架的支撑避免了胶带的皱折与晶粒之相互碰撞。 DieDond 固晶之目的乃将一颗颗之晶粒置于导线架上并以银胶(epoxy)黏着固定。 固晶完成后之导线架则经由传输设备送至弹匣(magazine)内,以送至下一制程进行焊线。 WireBond 焊线乃是将晶粒上的接点以极细的金线(18〜50卩m连接到导线架之内引脚,进而藉 此将IC晶粒之电路讯号传输至外界。 Mold 封胶之主要目的为防止湿气由外部侵入、以机械方式支持导线、内部产生热量之去除及 提供能够手持之形体。 其过程为将导线架置于框架上并预热,再将框架置于压模机上的封装 模上,再以树脂充填并待硬化。 /Trim/Form 剪切之目的为将导线架上封装完成之晶粒独立分开,并把不需要的连接用材料及部份凸 出之树脂切除(dejunk)。 成形之目的则是将外引脚压成各种预先设计好之形状,以便于装 置于电路版上使用。 剪切与成形主要由一部冲压机配上多套不同制程之模具,加上进料及出 料机构所组成。 Mark印字乃将字体印于封装完的胶体之上,其目的在于注明商品之规格及制造者等信息。 11/16 半导体IC集成电路制造流程 Inspection芯片切割之目的为将前制程加工完成之晶圆上一颗颗之检验之目的为确定封装完成之 产品是否合于使用。 其中项目包括诸如: 外引脚之平整性、共面度、脚距、印字是否清晰及 胶体是否有损伤等的外观检验。 I
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